Be One Lab Functional Verification Methodology and Flow培訓班 |
入學要求 |
學員學習本課程應具備下列基礎知識:
◆ 電路系統的基本概念。 |
班級規模及環境--熱線:4008699035 手機:15921673576/13918613812( 微信同號) |
為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人,多余人員安排到下一期進行。 |
上課時間和地點 |
上課地點:【上!浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
近開課時間(周末班/連續班/晚班): Lab Functional Verification:2025年3月24日............................ |
實驗設備 |
☆資深工程師授課
◆外地學員:代理安排食宿(需提前預定)
☆注重質量
☆邊講邊練
☆合格學員免費推薦工作
專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力
得到大家的認同,受到用人單位的廣泛贊譽。
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曙 海 新 優 惠 |
◆在讀學生憑學生證,可優惠500元。 |
.質.量.保.障. |
1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
2、培訓結束后免費提供半年的技術支持,充分保證培訓后出效果;
3、培訓合格學員可享受免費推薦就業機會。 。專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力得到大家的認同,受到用人單位的廣泛贊譽。 |
Be One Lab Functional Verification Methodology and Flow培訓班 |
階段一
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What is functional verification and what is being verified
Formal Verification,Equivalence Checking,Model checking,
Functional Verification,Test Bench Generation
- Functional Verification Approaches
Black-Box,White-Box,Grey-Box
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The Verification Process
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Specification and Test Plan ((Specification->Features->Test cases)
Direct 、Direct-Random and Random Test Case
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Advanced Verification Methodology
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System//Chip/Module Level Verification
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Behavioral Hardware Description Languages
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Stimulus and Response
Generating complex waveforms,Self-Checking test benches,Complex
Response,Predicting the output
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How to build reusable test bench
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Test Bench Acceleration
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Coverage Analysis in the Design Flow
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Feature Coverage and Code Coverage (Line Condition Toggle FSM)
Coding Guidelines
Structure,Naming Convention,Comments,Syntax,Debugging
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Simulation Management
Modeling reset,Writing Good Behavioral Model,Regression Management
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Assertions Methodology
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Formal Verification ((Design Rule Check)
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Vector--based Verification
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Memory Verification
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Project Management and Verification Experience
Introduce the useful verification experience that have been
successfully used to produce one-passed ASICs,SoC,board,and
entire systems.
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Verisity 's Specman e language
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Verisity 's e VC(e Verification Component)
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Verisity 's e RM(e Reuse Methodlogy)
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